[자연과학] 전기전자 實驗 보고서 - LR회로 實驗보고서
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작성일 20-12-23 13:28
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3. 회로를 꾸민 후, 저항과 다이오드를 연결한다. 전류는 지수적으로 증가할 것이고 이는 다음과 같다.
여기에서 은 유도상수와 그 양이고 은 유도 시간 상수이다.2. p51.LR Circuit 파일을 연다. 목적유도기-저항기 회로에서 유도기를 거친 전압과 저항기를 거친 전압의 관계 DC회로에서 유도자를 거친 전류와 유도자의 작용의 관계를 알아보는 test(실험) 이다. 그러나 유도기가 전류의 증가에 反應(반응)하여 반대의 emf를 발생하기 때문에 이러한 안정된 상태의 전류를 만드는 데에는 시간이 걸린다.4. 설정 값을 3V, 5Hz로 Sample Rate 10,000Hz로 맞춘다. 유도기를 거친 전압은 0이다.Imax=V0/R 여기에서 는 적용된 전압이고 은 회로에서의 총 저항이다.시간 가 된 후에, 지속적인 상태의 전류 가 성립되고 저항기를 거친 전압은 적용 된 전압 과 같다. 유도 시간 상수는 전류가 성립되는데 걸리는 시간의 측정(測定) 치이다. 유도 시간 상수는 전류가 그 최대치의 63%까지 증가하는 데 걸린 시간(혹은 최대치의 37%까지 떨어지는데 걸린 시간)이다.
5. Sampling Options`Automatic Stop Time을 0.5로 맞춘다.방법
1. 바나나 플러그 패치 코드를 interface의 출력 포트에 연결한다.6. Start 버튼을 눌러서 test(실험) 을…(省略)
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실험결과/기타
다. 만약, 최대 전류가 성립된 후에, 전압 원이 꺼지면, 전류는 저항기를 거친 전압이 같아지고 유도기가 다시 0으로 감소하는 반대의 를 생성하는 동안 0으로 점차 감소할 것이다. 전류가 최대치의 반까지 증가하거나 감소하는데 걸린 시간은 다음과 같은 식에 의한 유도 시간 상수와 관련이 있다 저항기를 거친 전압이 로 주어지기 때문에, 저항기를 거친 전압은 지수적으로 증가하게 된다 유도기를 거친 전압은 다음과 같고 , 유도기를 거친 전압은 그 최대치에서 처음 하여 지수적으로 감소한다.
LR회로
test(실험) 목적 및 배경theory(이론)
theory(이론):DC 전압이 병렬의 유도기와 저항기에 적용될 때, 안정된 상태의 전류는 다음과 같이 성립될 것이다.
